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VHDL程序設計（第二版）

【作　者】：曾繁泰，陳美金著

【叢編項】：EDA工程系列叢書

【裝幀項】：精裝 26cm / 420

【出版項】：清華大學出版社 / 2001-01-01

【ISBN號】：9787302038962 / 7302038961

【原書定價】：￥37.00　有8家書店打折銷售　

【主題詞】：計算機－計算機輔助設計與工程計算－ VHDL

【圖書簡介】
　　《VHDL程序設計》是EDA工程系列叢書之二。VHDL硬件描述語言是數字電路設計者、大規模專用集成電路（ASIC）設計者與電子設計自動化（EnA）工具之間的接口語言，是現代電子設計的基礎語言。硬件描述語言種類很多，成為IEEE標準的語言有兩種：VHDL和VerilogHDL。本書從語法規則、程序結構兩個方面介紹VHDL語言，重點介紹VHDL語言基礎及其程序設計。第一篇語法基礎介紹了VHDL語言的對象、數據類型、基本語句、程序結構。第二篇程序設計從應用角度介紹常見基本模塊的設計方法，對一些有實用價值、有重復可利用潛力的模塊（D）、計算機系統模塊做了介紹。同時介紹了建立自有知識產權的IP模塊的方法。第一篇力求概念清楚，第二篇力求實踐豐富。本書可以作為電子類、計算機類專業的高年級本科生、研究生的教材或教學參考書，也可以作為數字電路設計人員、大規模專用集成電路（ASIC）設計人員的工具書和參考書。

【本書目錄】
第一篇  VHDL語言基礎
   第1章  概述
     1. 1  硬件描述語言的誕生
     1. 2  HDL語言的種類
     1. 3  VHDL語言開發環境及硬件平臺
   第2章  VHDL程序結構
     2. 1  VHDL程序基本結構
     2. 1. 1  實體的組織和設計方法
     2. 1. 2  實體說明
     2. 1. 3  類屬說明
     2. 1. 4  端口說明
     2. 1. 5  實體說明部分
     2. 1. 6  實體說明語句部分
     2. 2  結構體
     2. 2. 1  結構體命名
     2. 2. 2  定義語句
     2. 2. 3  并行處理語句
     2. 3  結構體的3種描述方法
     2. 3. 1  結構體的行為描述
     2. 3. 2  結構體的數據流描述法
     2. 3. 3  結構體的結構化描述法
     2. 4  結構體的3種子結構設計方法
     2. 4. 1  采用多進程描述復雜結構體的方法
     2. 4. 2  采用多模塊描述復雜結構體的方法
     2. 4. 3  采用于程序調用的結構體描述法
   第3章  VHDL語言的客體及其分類
     3. 1  標識符
     3. 1. 1  短標識符
     3. 1. 2  擴展標識符
     3. 2  對象
     3. 2. 1  常量
     3. 2. 2  變量
     3. 2. 3  信號
     3. 2. 4  文件
     3. 3  數據類型
     3. 3. 1  標準定義的數據類型
     3. 3. 2  用戶定義的數據類型
     3. 4  類型轉換
     3. 4. 1  用類型標記法實現類型轉換
     3. 4. 2  用函數法進行類型轉換
     3. 4. 3  用常數實現的類型變換
     3. 4. 4  數據類型的限定
     3. 4. 5  IEEE標準數據類型“std_logic”和“std_logic_vector"
     3. 5  詞法單元
     3. 5. 1  注釋
     3. 5. 2  數字
     3. 5. 3  字符和字符串
     3. 5. 4  位串
     3. 6  運算操作符
     3. 6. 1  邏輯運算符
     3. 6. 2  算術運算符
     3. 6. 3  關系運算符
     3. 6. 4  并置運算符
     3. 6. 5  操作符的運算優先級
   第4章  VHDL語法基礎
     4. 1  并行語句
     4. 1. 1  進程語句(Process)
     4. 1. 2  WAIT語句
     4. 1. 3  Block語句
     4. 1. 4  過程和過程調用語句(CONCURRENT PROCEDURE CALL)
     4. 1. 5  并行斷言語句(ASSERT)
     4. 1. 6  并行信號賦值語句CONCRRENT SIGNAL ASSIGNMENT)
     4. 1. 7  信號代入語句(SIGNAL ASSIGNMENT)
     4. 1. 8  參數傳遞語句(GENERIC)
     4. 1. 9  通用模塊. 元件調用語句(COMPONENT)
     4. 1. 10  端口映射語句(PORT MAP)
     4. 1. 11  生成語句(GENERATE)
     4. 2  順序語句
     4. 2. 1  IF語句
     4. 2. 2  CASE語句
     4. 2. 3  LOOP語句
     4. 2. 4  用LOOP循環控制的NEXT語句
     4. 2. 5  EXIT語句
     4. 2. 6  RETURN語句
     4. 2. 7  REPORT語句
     4. 2. 8  NULL語句
     4. 3  命名規則及注釋
   第5章  屬性的描述與定義
     5. 1  預定義屬性
     5. 2  數值類屬性函數
     5. 2. 1  一般數據的數值屬性函數
     5. 2. 2  數組的數值屬性函數
     5. 2. 3  塊的數值屬性函數
     5. 3  屬性函數
     5. 3. 1  數據類型的屬性函數
     5. 3. 2  數組的屬性函數
     5. 3. 3  信號的屬性函數
     5. 4  帶屬性函數的信號
     5. 4. 1  signal'DELAYED(time)屬性函數的信號
     5. 4. 2  帶有signal'STABLE(time)屬性函數的信號
     5. 4. 3  含有signal'QUIET屬性函數的信號
     5. 4. 4  帶有signal'TRANSACTlON屬性函數的信號
     5. 5  數據類型的屬性函數
     5. 6  數據區間的屬性函數
     5. 7  ATTRIBUTE語句
   第6章  信號處理
     6. 1  信號的驅動源
     6. 2  信號的延遲
     6. 2. 1  信號的慣性延遲(INERTIAL)
     6. 2. 2  信號的傳輸延遲(TRANSPORT)
     6. 3  仿真周期
     6. 4  信號的6延遲
     6. 4. 1  6延遲的意義. 用途及使用方法
     6. 4. 2  延緩進程(POSTPONED)
   第7章  VHDL程序設計基礎
     7. 1  層次化設計方法概述
     7. 2  庫(libraries)
     7. 2. 1  庫的概念及語法
     7. 2. 2  庫的分類
     7. 3  程序包(PACKAGES)
     7. 3. 1  程序包說明
     7. 3. 2  程序包體
     7. 3. 3  常用資源庫中的程序包
     7. 4  子程序
     7. 4. 1  函數(FUNCTION)
     7. 4. 2  過程
     7. 5  文件輸入／輸出程序包TEXTIO
     7. 6  元件例化
     7. 6. 1  構造元件
     7. 6. 2  構造程序包
     7. 6. 3  用戶構造元件庫
     7. 6. 4  元件的調用
   第8章  配置
     8. 1  默認連接和默認配置
     8. 2  配置說明
     8. 2. 1  元件配置
     8. 2. 2  實體—結構體對的元件配置
     8. 2. 3  端口映射
     8. 2. 4  實體映射
     8. 3  塊的配置
     8. 4  結構體的配置
     8. 5  配置說明的參數指定功能(Generic)
     8. 5. 1  在結構體中用Generic作參數指定
     8. 5. 2  在配置說明中用Generic作參數指定
   第9章  子程序重載

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